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Für Unternehmen Auf einen Blick
- Aufgaben: Entwickle und pflege UVM SystemVerilog Verifizierungsumgebungen für hochleistungsfähige Netzwerklösungen.
- Arbeitgeber: Innovatives Unternehmen mit einem unterstützenden, teamorientierten Umfeld.
- Mitarbeitervorteile: Flexible Arbeitszeiten, hybrides Arbeiten, wettbewerbsfähiges Gehalt und Karrierechancen.
- Warum dieser Job: Gestalte die Zukunft der Technologie und arbeite an spannenden Projekten.
- Gewünschte Qualifikationen: Mindestens 10 Jahre Erfahrung in der funktionalen Verifizierung und starke UVM SystemVerilog Kenntnisse.
- Andere Informationen: Regelmäßige Teamevents und die Möglichkeit, bis zu sechs Wochen im Jahr zu reisen.
Das voraussichtliche Gehalt liegt zwischen 72000 - 84000 € pro Jahr.
Standort: Mannheim, Deutschland (Hybrid) oder Villach, Österreich (Hybrid)
Anstellungsart: Festanstellung, Vollzeit
Gehalt: Wettbewerbsfähig und verhandelbar
Rollenübersicht
Wir suchen einen erfahrenen Staff / Principal Functional Verification Engineer, um unser Team zu verstärken, das leistungsstarke On-Chip-Netzwerk (NoC) Lösungen liefert. Sie werden UVM SystemVerilog Verifizierungsumgebungen entwickeln und pflegen, mit Designteams zusammenarbeiten und sicherstellen, dass Produkte von hoher Qualität pünktlich veröffentlicht werden.
Verantwortlichkeiten
- Entwicklung und Pflege von UVM SystemVerilog Verifizierungsumgebungen für NoC IP
- Definition und Ausführung von funktionalen Verifizierungsplänen
- Entwurf und Verbesserung von Verifizierungstestbenches
- Debugging komplexer Design- und Verifizierungsprobleme
- Überwachung der Abdeckungsabschlüsse und Regressionstests
- Zusammenarbeit mit Design- und funktionsübergreifenden Teams für erfolgreiche Produktveröffentlichungen
Anforderungen
- B.S./M.S. in Elektrotechnik, Computertechnik, Physik oder verwandtem Bereich
- 10+ Jahre relevante Erfahrung
- Starke Expertise in UVM SystemVerilog und SystemVerilog Assertions
- Erfahrung mit Cadence Xcelium/vManager bevorzugt
- HDL-Coding-Erfahrung (Verilog/SystemVerilog/VHDL) von Vorteil
- Scripting-Fähigkeiten: Python, TCL, Bash
- Ausgezeichnete Englischkenntnisse; Deutsch von Vorteil
Was wir bieten
- Flexible Arbeitszeiten und hybride/remote Optionen
- Wettbewerbsfähiges Gehalt und Karrierewachstumsmöglichkeiten
- Teamorientierte, unterstützende Umgebung mit regelmäßigen Veranstaltungen
- Workation-Option: bis zu sechs Wochen pro Jahr
Standorte: Mannheim, Deutschland oder Villach, Österreich
Wenn Sie interessiert sind, kontaktieren Sie uns bitte und senden Sie Ihren Lebenslauf.
Staff / Principal Functional Verification Engineer (m/f/d) Arbeitgeber: microTECH Global Limited
Kontaktperson:
microTECH Global Limited HR Team
StudySmarter Bewerbungstipps 🤫
So bekommst du den Job: Staff / Principal Functional Verification Engineer (m/f/d)
✨Tipp Nummer 1
Netzwerken ist der Schlüssel! Nutze Plattformen wie LinkedIn, um mit Leuten aus der Branche in Kontakt zu treten. Frag nach Informationen über die Firma oder mögliche offene Stellen – oft erfährt man so mehr als in einer Stellenanzeige.
✨Tipp Nummer 2
Bereite dich auf Vorstellungsgespräche vor, indem du typische Fragen und technische Herausforderungen übst. Wir empfehlen, deine Antworten laut zu üben, damit du sicherer auftrittst. Zeig dein Wissen über UVM SystemVerilog und deine Erfahrungen!
✨Tipp Nummer 3
Sei proaktiv und bewirb dich direkt über unsere Website! Das zeigt dein Interesse und Engagement. Außerdem hast du so die Möglichkeit, dich von anderen Bewerbungen abzuheben.
✨Tipp Nummer 4
Bleib dran und folge nach dem Gespräch nach! Ein kurzes Dankeschön per E-Mail kann einen bleibenden Eindruck hinterlassen. Es zeigt, dass du wirklich an der Position interessiert bist und hebt dich von anderen Bewerbern ab.
Diese Fähigkeiten machen dich zur top Bewerber*in für die Stelle: Staff / Principal Functional Verification Engineer (m/f/d)
Tipps für deine Bewerbung 🫡
Mach deinen Lebenslauf einzigartig: Dein Lebenslauf sollte nicht nur deine Erfahrungen auflisten, sondern auch zeigen, was dich besonders macht. Hebe deine Fähigkeiten in UVM SystemVerilog und deine 10+ Jahre Erfahrung hervor, um uns zu beeindrucken!
Anpassung ist der Schlüssel: Stell sicher, dass du dein Anschreiben an die Stelle anpasst. Zeige uns, wie deine bisherigen Projekte und Erfahrungen direkt mit den Anforderungen der Rolle als Functional Verification Engineer zusammenhängen.
Sei präzise und klar: Vermeide es, zu viel Fachjargon zu verwenden, wenn es nicht nötig ist. Wir schätzen klare und präzise Kommunikation, also achte darauf, dass deine Bewerbung leicht verständlich ist.
Bewirb dich über unsere Website: Um sicherzustellen, dass wir deine Bewerbung schnell und effizient bearbeiten können, bewirb dich bitte direkt über unsere Website. So bist du auf der sicheren Seite!
Wie du dich auf ein Vorstellungsgespräch bei microTECH Global Limited vorbereitest
✨Verstehe die technischen Anforderungen
Mach dich mit den spezifischen Technologien und Tools vertraut, die in der Stellenbeschreibung erwähnt werden, wie UVM SystemVerilog und Cadence Xcelium. Bereite Beispiele aus deiner bisherigen Erfahrung vor, die zeigen, wie du diese Technologien erfolgreich eingesetzt hast.
✨Bereite dich auf technische Fragen vor
Erwarte technische Fragen zu Verifikationsmethoden und -strategien. Übe, wie du komplexe Design- und Verifikationsprobleme debuggen würdest. Es kann hilfreich sein, typische Szenarien durchzugehen und deine Lösungsansätze klar und präzise zu formulieren.
✨Zeige Teamarbeit und Kommunikation
Da die Rolle viel Zusammenarbeit erfordert, sei bereit, Beispiele zu nennen, wie du erfolgreich mit anderen Teams gearbeitet hast. Betone deine Kommunikationsfähigkeiten, insbesondere wenn du auf Englisch oder Deutsch kommunizieren musst.
✨Fragen stellen ist wichtig
Bereite einige Fragen vor, die du dem Interviewer stellen kannst. Das zeigt dein Interesse an der Position und hilft dir, mehr über die Unternehmenskultur und die Erwartungen an die Rolle zu erfahren. Fragen zur Teamdynamik oder zu aktuellen Projekten sind immer gut!
